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使用TCL腳本分配FPGA管腳

自動生成Tcl文件

 Project -> Generate Tcl File for Project...

彈出如下對話框,設置腳本路徑。

編輯引腳

使用set_location_assignment分配管腳如下:

第一次配制時,沒有set_location_assignment語句,自已在set_global_assignment語句下一行添加即可。

執行Tcl腳本

 Tools -> Tcl Scripts...

選中剛新建的Tcl文件,點擊Run運行即可!

答疑解惑

1. 為什麼Tcl中沒有為每個引腳分配輸入輸出屬性,也能保證引腳屬性正確?

因為引腳輸入輸出屬性都已經在Verilog語言的module中或原理圖中設置了,如下圖,

 

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