git://github.com/adream307/FIRTest.git
1.使用Filterbuilder生存濾波器的Verilog代碼，濾波器設計如下，選擇定點數，並且小數部位為0。生存verilog代碼時，選擇全並行。
2. git clone git://github.com/adream307/FIRTest.git
cd FIRTest
make
輸入數據頻譜
濾波後輸出數據頻譜
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